LC4256V-75TN144C 프로그래밍 가능한 논리 장치 CPLD FPGA 패키지 TQFP-144 정품 원본스토어 가기

LC4256V-75TN144C 프로그래밍 가능한 논리 장치 CPLD FPGA 패키지 TQFP-144 정품 원본

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特征 高性能 fMAX = 400 MHz最大工作频率 tPD = 2.5 ns传播延迟 多达四个全局时钟引脚,可编程 时钟极性控制 每次输出高达80分 易于设计 具有独立时钟的增强型宏单元, 复位、预设和时钟使能控制 多达四个全球运行经验控制 每个I/O引脚的单独本地OE控制 出色的首次安装和改装 快速路径、快速锁定TM路径和宽点 小路 宽输入门控(36个输入逻辑模块)实现快速 计数器、状态机和地址解码器 零功率(ispMACH 4000Z)和低功率 功率(4000伏特/安培/摄氏度) 典型静态电流10安(4032赫兹) 典型静态电流1.3 mA (4000C) 1.8 V内核低动态功耗 ispMACH 4000Z工作电压低至1.6 V VCC 广泛的设备产品 多温度范围支持 –商用:0至90°C结(Tj ) –工业:–40至105°C结(Tj ) –扩展:–40至130°C结(Tj ) 对于AEC-Q100兼容设备,请参考 LA-ispMACH 4000V/Z汽车数据手册 简单的系统集成 面向功耗敏感型消费者的卓越解决方案 应用程序 采用3.3 V、2.5 V或1.8 V LVCMOS I/O供电 采用3.3 V (4000V)、2.5 V (4000B)或 1.8 V (4000C/Z)电源 针对LVCMOS 3.3、LVTTL和的5 V容差I/O PCI接口 热插拔 开漏能力 输入上拉、下拉或总线保持器 可编程输出压摆率 兼容3.3 V PCI IEEE 1149.1边界扫描可测试 3.3 V/2.5 V/1.8 V系统内可编程 (ISP)使用IEEE 1532兼容接口 具有快速设置路径的I/O引脚 无铅封装选项

 

 

 

 

 

 

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